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GNU LD 葡京娱乐网址中 location counter 到底是怎样改变的?

2018年05月10日 常见问题  ⁄ 共 1271字 GNU LD 葡京娱乐网址中 location counter 到底是怎样改变的?已关闭评论
本文内容无意间搜到,正好之前也有这个困惑,所以转来做个备份: 引入问题; 我写了一个简单的汇编语言例程,text.s section .text .globl _start _start: movq $1, %rax movq $0, %rbx int $0x80 用下面的ld脚本test.lds进行链接 SECTIONS { . = 0x10; label_1 = .; custom_section : { . = 0x20; label_2 = . ; label_3 = ABSOLUTE(.) ; *(.text) ; } } 链接命令为: as test.c...
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入手便宜VPS,自己搭建梯子过程(科学上网)

2018年05月08日 环境搭建  ⁄ 共 1463字 入手便宜VPS,自己搭建梯子过程(科学上网)已关闭评论
前段时间整了一个国外VPS,想用来上gooooooooogle查查资料什么的,选的是Virmach(主要是便宜,穷。。。。。。。。。。。。。。。。): Virmach是一家成立于2014年的国外VPS主机商,主打廉价VPS套餐,产品基于OpenVZ和KVM架构,数据中心包括美国洛杉矶、纽约、达拉斯、西雅图、凤凰城、芝加哥、亚特兰大、圣何塞等。商家同时也提供大硬盘大带宽VPS主机系列。 首先登陆Virmach官网,注册账号https://virmach.com/,注册完就可以...
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YUV格式数据接收,显示葡京娱乐网址到VGA

2018年04月15日 FPGA开发  ⁄ 共 406字 YUV格式数据接收,显示葡京娱乐网址到VGA已关闭评论
改了下ov7670的配置,改为YUV422输出,改了之后对于capture模块来说改动不是很大,像素时钟和RGB565的频率是一样的,现在亮度和速度信号分离开了,可以只把亮度信息显示出来,并在屏幕上叠加上了帧频: yuv 可以看出图像是黑白的,左下角绿色的是帧频,同时写了个uart串口模块,通过串口把帧频也打印了出来,1S打印一次: com 仔细一看串口打印的和屏幕叠加的数对不起来,串口打印的(0X1F 十进制是31),屏幕得加的是32,应该...
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简单字符叠加测试,画框及十字线、中英文显示

2018年04月09日 FPGA开发  ⁄ 共 272字 简单字符叠加测试,画框及十字线、中英文显示已关闭评论
抽空在原来程序基础上,简单写了一个OSD模块,使用代码简单画了一个框及十字线,更复杂OSD功能还需要再深入学习: osd osd osd
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终于出图像了,记录一下

2018年04月03日 FPGA开发  ⁄ 共 718字 终于出图像了,记录一下已关闭评论
调试了快半个月,终于出图像了,其中碰到了一些问题也查了好久,下面把碰到的一些现象贴出来大题说一下: 刚开始出的图像是花的,红红绿绿,但是基本物体的形状还是可以看清,推测不可能是sdram数据存取问题,可能色彩空间编码有问题: pic1 查看了7670数据捕获输出模块,推测可能是采集的时候,多采了一个像元,或少采了一个像元,造成色彩编码错位(主要是每一行的第一个和最后一个像元),这样两个8位拼成的16位RGB数据就有...
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sdram 控制器代码(使用VHDL编写)

2018年03月30日 FPGA开发  ⁄ 共 14082字 sdram 控制器代码(使用VHDL编写)已关闭评论
最近一直想着学学视频处理方面的知识,选定的平台是altera的一款FPGA,摄像头用的OV7670,输出显示为VGA,打算目前不先跑软核,完全使用FPGA处理,首先面临的问题就是ov7670的初始化,0v7670的通讯是IIC的,先写了一个IIC Master控制器,见前面一篇文章《IIC总线—-iic master使用VHDL的FPGA实现》 ,这篇文章只是实现了标准的IIC通信接口,ov7670的寄存器配置还需要另写葡京娱乐网址,这部分就是一直循环的写7670的寄存器,没有什么...
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IIC总线—-iic master使用VHDL的FPGA实现

2018年03月10日 FPGA开发  ⁄ 共 7004字 IIC总线—-iic master使用VHDL的FPGA实现已关闭评论
代码参考网上大神程序,加了一些修改 贴出代码: 写了个testbench测试了一下这个模块,仿真时许如下: iic-tb iic_tb library ieee; use ieee.std_logic_1164.all; entity iic_master is generic ( clock_frequency : positive := 100000000; baud : positive := 100000 ); port ( i_clk : in std_logic; i_rst_n : in std_logic; i_addr : in std_logic_vector(6 downto 0); --目标地址 i_rw : in std_lo...
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